H.265/HEVC Encoder IP Architecture 系统架构
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H265enc V1.0 System Architecture 系统架构
系统架构框图
模块
- TPU: 一个外置的主控制器,可做码率控制,Header添加等(目前1.0版本代码未包括)
- Coarse Motion Estimation: 粗粒度运动估计(软硬件实现方案皆可)
- Fine Motion Estimation: 细粒度运动估计,包括IME(Full Search),FME(Full Search)
- Pre Intra Prediction;粗粒度Intra预测(软硬件实现方案皆可)
- Post Intra Prediction: 细粒度Intra预测(支持All Intra Mode)
- Transform&Quantization: 4/8/16/32全模式DCT/IDCT,量化计算
- CABAC:熵编码
- SAO:SAO
- DB:块滤波
接口
目前的代码顶层是h265core,需要自行封装AXI, APB接口
码率控制
可集成一个轻量级的MCU,比如MIPS、ARM M0进来即可
Slice Header,SPS,PPS
由主处理器或者内置集成轻量级MCU用软件方法产生,目前的H265core仅仅产生每个LCU的bitstream,方便用户根据自己需求来选择加入Header方案。
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