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F
赞一个，在中国首开先例，加油。
B
@bytree1 目前sao没支持edge， LCU只能是64的 32的没支持，帧压缩没支持
@asuperbird 编码器延迟理论上很低的，大概5w个时钟周期左右。通过仿真能看到精确的延迟。编码系统延迟还包括帧缓存延迟，bitstream的缓存延迟，通讯延迟等。
S
@现代楼 @duoerpu ，我们公司需要使用H264/265的FPGA编解码IP核，如果有资源或者开发能力但又缺乏资金可以跟我联系。sckaee@126.com
@wlf8263121 这个我们要稍晚一点出，现在暂时没有
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@bo 在modelsim/questasim中采用systemverilog语言开发基于UVM验证方法学的测试平台testbench，测试起来非常方便（可以搜索一下关于IC验证工程师的相关岗位信息）
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@070411209 解决了VIP IP问题，解决了不同FPGA型号无法映射问题；
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@bo 请看上一条回复
@bo 用仿真工程h265_encoder_v1.0提供的check文件也不可以。 bs2hevc提供的测试文件没问题。也就是说纯软件的码流打包没问题，但是没办法和仿真工程对接起来。
视频已经处了，请大家移步 http://www.openasic.org/topic/23/h-265-video-encoder-fpga-demo-video
@wds 不好意思 这个网站没有视频播放功能
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@bo 可能是文件格式不对7z上传了不能显示，zip和pdf可以
@wr115946873 需要加slice header, pps, sps等。 RTL输出的仅仅是LCU级别的码流，不带任何header信息
@pilmihilmi Thank you for your suggestion.
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introduction和user guide两个文档确实不能下载
@songmao 现在 了
simulation一下就出来了
@quwer 目前是这样的，我们没有专门针对灰度图做encoder，会增加一点码率吧。虽然UV都是0，还是需要编码一点信息进去。
@duoerpu 好的，你可以联系我， fanyibo@fudan.edu.cn
@wr115946873 这是一个QCIF的测试图