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F
赞一个，在中国首开先例，加油。
B
@bytree1 目前sao没支持edge， LCU只能是64的 32的没支持，帧压缩没支持
S
@现代楼 @duoerpu ，我们公司需要使用H264/265的FPGA编解码IP核，如果有资源或者开发能力但又缺乏资金可以跟我联系。sckaee@126.com
@eebq 赞！ 好的，没问题。 你可以先放上来，我随后把帖子转到“代码发布“栏目下
@wlf8263121 这个我们要稍晚一点出，现在暂时没有
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@bo 在modelsim/questasim中采用systemverilog语言开发基于UVM验证方法学的测试平台testbench，测试起来非常方便（可以搜索一下关于IC验证工程师的相关岗位信息）
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@070411209 解决了VIP IP问题，解决了不同FPGA型号无法映射问题；
视频已经处了，请大家移步 http://www.openasic.org/topic/23/h-265-video-encoder-fpga-demo-video
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@bo 可能是文件格式不对7z上传了不能显示，zip和pdf可以
@wr115946873 需要加slice header, pps, sps等。 RTL输出的仅仅是LCU级别的码流，不带任何header信息
@pilmihilmi Thank you for your suggestion.
@manucrespo 整个设计都是同步时钟的，SDC只要约束到端口就可以了
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@bo 非常感谢，找到了！
@songmao 现在 了
simulation一下就出来了
@quwer 目前是这样的，我们没有专门针对灰度图做encoder，会增加一点码率吧。虽然UV都是0，还是需要编码一点信息进去。
J
同样的，introduction和user guide两个文档不能下载，请检查一下:)
好的，我试试看。
个人觉得放在github上较好，在那也有不少HDL相关的项目。以前用opencores.org，但其SVN和管理起来不太好。
昨天没有在github上找到，所以基于v1.0偷偷把建了一个，方面自己后续的学习和研究 https://github.com/Bearzeng/h.265_encoder
Video Demo
Links video demo 中文 video demo English ,sorry about poor english.
Looks like your connection to OpenASIC was lost, please wait while we try to reconnect.
了