@crazybingo 好的,非常感谢!!
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2017.1.13 上海丨开源H.265 Encoder IP Core交流研讨会
开源H.265 Encoder IP Core
H.265 Video Encoder IP Core 是开源的H.265硬件视频编码器,实现了H.265的大部分功能。它由复旦大学专用集成电路与系统国家重点实验室(State Key Lab of ASIC & System,Fudan University)视频图像处理实验室(VIP Lab)范益波教授研究团队开发完成,并开放源代码。任何组织个人可以无偿使用上述代码用于研究和生产目的,VIP Lab将会持续更新并维护H.265硬件视频编码器的开发。
- 开源项目网址 :www.openasic.org
演讲人
- 范益波,博士,副教授。2003年毕业于浙江大学信电系获学士学位,2006年毕业于复旦大学微电子系获得理学硕士学位,2009年毕业于日本早稻田大学获得工学博士学位。2009年至2010年加入上海交通大学信息学院任助理教授,现任复旦大学微电子学院副教授。在复旦大学工作期间,创立图像、视频多媒体处理实验室(Video Image Processing Lab, VIP Lab)主要从事图像处理、视频编解码、多媒体SoC系统的算法、硬件和芯片设计研究。
- VIP Lab成员
本次活动内容
- 本开源项目简介。
介绍H.265开源项目的基本情况,为什么我们要做开源?与商业版本IP的差距? - 开源H.265 Encoder IP使用指南。
介绍目前IP几个端口的基本配置功能,以及需要自行添加的外部模块。做一个完整的FPGA Demo需要准备什么? - 开发者计划, 如何更方便地让有兴趣的同学参与项目。
介绍基本H.265流水线情况以及目前各算法模块代码和测试方法。对于一个新手希望加入项目开发该如何着手?对于一个视频编码领域高级码农,该如何参与?对于一个项目团队、一个公司希望以该项目作为一个起点,该如何启动? - 自由交流,问题环节。
对于IP本身的问题讨论、对于本开源项目下一步的建议与意见,讨论交流未来的Todo方向和计划。
活动详情
【时间】:2017年1月13日,19:00--21:00(18:30签到)
【地点】:上海浦东新区碧波路635号传奇广场3楼IC咖啡,近地铁2号线张江高科站5号口(祖冲之路松涛路)
【费用】:门票40元/位 (赠送指定饮品或甜品一份);门票60元/位(赠送指定饮品+甜品)(注:费用是IC咖啡收取并使用的,与本项目无关;IC咖啡免费提供场地)
【报名】:直接去就行关注我们
微信公众号: OpenASIC
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H.265 FPGA Report资源利用完整报告
说明
Board: TR4 link
FPGA: Stratix IV GX EP4SGX530
综合工具:Quartus
综合版本包括AXI、DDR控制器、DVI接口等外围电路。下载
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RE: 对于想参加项目开发的同学
@zhangbin_yuxuan 可以先看看书,《The H264 Advanced Video Compression Standard第二版》, 《VLSI Design for Video Coding》,后面可以看看论文、代码等。
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H.265 Video Encoder FPGA Demo Video
Video Link 视频链接
http://v.qq.com/page/f/1/6/f03609q5n16.html
说明
FPGA Demo中的app程序是串行执行过程
- 取一帧图像
- 编码一帧
- 网络打包一帧并发送
- 重复到步骤1
我们采用了一个非常简化的app打包程序,因此可能在播放过程中出现一点乱码,主要原因是timestamp不匹配、场景切换与GOP不匹配等。
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RE: 请问HEVC的IP CORE和HM比的话性能如何
硬件编码性能肯定不能跟HM的性能比的。HM穷举起来一定能搜索到最优的模式组合,而硬件为了实时性要求一定是采用快速算法牺牲掉编码性能的。 intel和海思都是大厂,据我了解海思做H.265的都几百人的团队,他们的芯片也仅能做到差30%~50%的话,目前应该不存在差HM10%的硬件编码器。
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RE: H.265 Video Encoder IP RTL Simulation 方法
由于本项目仿真一直在Linux下,如果采用Window平台仿真,可能会出现如下错误
at 00000600, Frame Number = 00, mb_x_first = 00, mb_y_first = 00 # at 00049380, Error! # (MV_X,MV_Y) should be (0c,0c), however is (04,0d) # at 00050020, Error! # FIME_PARTITION should be 000000000000000000000000000000000000000000, however is 001000000000000000000000000000001100000011 # at 00050065, Frame Number = 00, mb_x_first = 01, mb_y_first = 00 # ** Note: $finish : ./tb_top.v(783) # Time: 50380 ns Iteration: 0 Instance: /tb_top
修改办法: 修改/sim/h265core/tb_top.v
# 将所有的$fopen语句修改一下 $fopen( XXXX ,"r" ); -> $fopen( XXXX ,"rb" )
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OpenASIC微信公众号发布
主要发布一些最新消息、线下讨论交流活动等。
方便不经常用PC上论坛的同学们知晓最新信息。
期望能定期举办一下现场研讨活动,推动本开源项目的常态化交流。计划1月中旬(13号)左右能搞一次现场交流讨论活动,初步定在张江地铁站的IC Caffe。
主题主要包括几个方面:- 开发者计划, 如何更方便地让有兴趣的同学参与项目
- IP使用指南,目前IP几个端口的基本配置功能,做一个完整的Demo还需要准备什么?
- Todo讨论,初步讨论一下未来Todo的方向和计划
- 自由交流,问题环节。
欢迎大家参与。
公众号:
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RE: 请问有没有H.264的RTL开源代码
@duoerpu 好的。 稍后我整理一下代码,开源发布!H.264目前实验室本身没有维护了,H.264 Intra encoder版本经过silicon prove, inter版本没有silicon过,有资金实力做silicon的我可以提供支持。
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RE: 范老师,看了您的代码,感觉学习了很多,我想问问里面的Intra Prediction,你们都用了哪些方法?您推荐什么方法呢?
intra prediction我们分成两个部分,pre intra做mode decision,post intra 做partiton decision。 目前版本的代码mode decision只传一个mode给post intra。 后期要预测的更准的话,需要多传几个mode。目前我们自己实验室测试下来,传8个mode给post intra就预测的很准了。
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关于文档
很抱歉,跟你们能接触到的大多数开源项目一样,本项目也没什么拿得出手的文档。
大家都懂的,码农都痛恨写文档。写文档不如写代码来的“实在”。-- 其实这是一个误解,从我的教学科研经历来看,能写得出一流文档的,才能担当得起一流的程序员。
对于本项目(H.265),也很幸运的是,虽然我们没有文档,但是我们有相关论文、专利。
相比大多数开源项目,这个也算是本项目的特色之一吧。有兴趣的同学可以去VIP Lab页面翻看 http://soc.fudan.edu.cn/vip/projects/gradproj/wiki/Publications ,还有历年的毕业生论文(中文的:fingers_crossed: )可以省去大家看英文的痛苦。无论是刚进入硬件领域想小试牛刀的初学者,还是功力深厚的资深码农,都是一个不错的参考,毕竟有胜于无嘛。当然,代码和论文差别还是很大的,搞过研究的都懂的。不要纠结于哪里哪里不同,什么什么地方看不懂,毕竟也不是项目文档,权当科普一下基础知识和基本架构思路吧。
相信能看完一个模块的论文和代码,基本上就能理解基本的架构和工作原理了,接下来看看论文、没事瞎想想,也就能出点自己的idea,进行架构层面的修改和优化了。就等着这个时候出个牛人,冒出一句“你们做的不咋地,我来改改”,那就功德圆满了。
写在平安夜11;59, 祝大家圣诞快乐
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对于想参加项目开发的同学
参与开发
目前代码量其实蛮大的,模块也挺多。对于一个新手,熟悉全部算法和整个硬件架构会比较困难。我准备尽快推出一个开发者计划,会对项目进行分门别类,开发者只需对单一模块进行算法研究和硬件开发(这个也是目前本实验室的做法)。
非常希望有更多的人愿意贡献自己的力量,帮助本项目完善代码!
也希望在中文社区里,在硬件、在芯片世界里有一只活跃的国人主导参与的开源队伍。关注我们
微信公众号: OpenASIC
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RE: 首款开源H.265 Video Encoder IP Core发布
@fighting C Model暂时不开放源代码,会对参与项目开发的人员开放代码。一般用户其实只需要RTL就够了